rezident (18.08.2021 13:59, просмотров: 310) ответил Mahagam на угу, только fMAX будет что-то типа 2MHz.-
- да не, задержки 15ns на логику, даже если 10 уровней вложения -
150ns, это уже 6MHz. проблемы будут только с многоразрядными
сумматорами, но там можно сделать многотактовую схему. да, будет
тупить чутка, но зато общая частота не пострадает. Mahagam(2 знак., 18.08.2021 14:34)
- Ну дык каждая обратная связь уполовинивает быстродействие, не? - rezident(18.08.2021 15:53)
- не. надо тупо считать сумму задержек. если условная К1533ЛА3 даёт
15нс задержки, то жирная логическая цепочка из 10 штук
последовательно даст 150нс, а значит период тактовой должен быть
чуть длиннее - типа 180нс, чтобы с запасом, то есть 5.55МГц.
втыкание ещё одной ЛА3 в цепь даст общую задержку уже в 165нс, клок
в 195нс = 5.13МГц. больше всего тупят цепи переноса. типа если мы
делаем 16-ти разрядный сумматор, то надо прогнать перенос через 16
бит, 16*15=240нс, и тогда Mahagam(368 знак., 18.08.2021 16:31)
- 74LS181 + 74S182 на 16 битах примерно те же 20МГц давали. - rezident(18.08.2021 17:12, ссылка)
- не. надо тупо считать сумму задержек. если условная К1533ЛА3 даёт
15нс задержки, то жирная логическая цепочка из 10 штук
последовательно даст 150нс, а значит период тактовой должен быть
чуть длиннее - типа 180нс, чтобы с запасом, то есть 5.55МГц.
втыкание ещё одной ЛА3 в цепь даст общую задержку уже в 165нс, клок
в 195нс = 5.13МГц. больше всего тупят цепи переноса. типа если мы
делаем 16-ти разрядный сумматор, то надо прогнать перенос через 16
бит, 16*15=240нс, и тогда Mahagam(368 знак., 18.08.2021 16:31)
- 10 уровней вложения дадут 3-кратную задержку. - Kpoк(18.08.2021 15:44)
- Ну дык каждая обратная связь уполовинивает быстродействие, не? - rezident(18.08.2021 15:53)
- да не, задержки 15ns на логику, даже если 10 уровней вложения -
150ns, это уже 6MHz. проблемы будут только с многоразрядными
сумматорами, но там можно сделать многотактовую схему. да, будет
тупить чутка, но зато общая частота не пострадает. Mahagam(2 знак., 18.08.2021 14:34)