caxapa.ru :: Походу наверное правильнее таки поставить генератор еще и на этой стороне и делить его обычным счетчиком (судя по статьям они дают меньший джиттер, чем всякие FPGA).

Yft (09.07.2018 14:31, просмотров: 194) ответил Evgeny_CD на TI CDCE813-Q1 ->

Походу наверное правильнее таки поставить генератор еще и на этой стороне и делить его обычным счетчиком (судя по статьям они дают меньший джиттер, чем всякие FPGA).

Ответить

- Джиттер и FPGA - это очень интересная тема. Evgeny_CD(321 знак., 09.07.2018 15:04 - 15:07)
  - 5M40Z Total jitter 0,2*UI где UI, как я понял время задержки типа 4-5нС. Т.о. почти 1нС, не слишком впечатляет. - Yft(09.07.2018 15:11)
    - У MAX 10 75 mUI и меньше на 100 МГц. - Evgeny_CD(09.07.2018 16:02)
      - Intel® MAX® 10 FPGA Device Datasheet FINPFD < 100 MHz ±750ps не впечатляет. - Yft(10.07.2018 09:59)
        
        В целом FPGA и малый джиттер несовместимые вещи. Возможно, в FPGA за $10k с этим лучше, но меня это никогда не интересовало. - Evgeny_CD(10.07.2018 10:34)
        
        Кстати, заметил, что в референсных проектах они делят тактовый сигнал одиночными SN74AUP1G80DCKT а не счетчиком, наверное в этом тоже есть своя сермяжная правда? - Yft(10.07.2018 10:42)
    - это какой-то неправильный ~~мед~~ джиттер, обычно речь идет о единицах-десятках ps - AVF(09.07.2018 15:47, ссылка)

Схемы, платы, компоненты