Evgeny_CD, Архитектор (30.09.2013 23:03, просмотров: 68) ответил 3m на Я тоже доку не курил. Просто такая архитектура естественна для двухчипового решения.-
- В некоторых документах явно сказано, что это SiP. До 2М Quad SPI Flash (скорость 100MHz) внутри ADSP-CM40x корпуса. PIC32(189 знак., 01.10.2013 00:46)
- Да, SIP. Насчет 100Мгц - она для всех команд, кроме чтения, как я понял. Для чтения 52 Мгц. За документ спасибо! - Evgeny_CD(01.10.2013 11:28)
- ADSP-CM40x internal SPI flash reads can occur at throughputs as high as 50 MBytes/second. 100 MHz * 4 / 8 = 50 MBytes/sec. Точнее - 34.50, т.к. есть аномалия :), которая накладывает 70% ограничение на теор. производительность. Внешняя QSPI память PIC32(32 знак., 01.10.2013 12:09)
- Спасибо! Все прояснилось. А полный список "аномалий" есть? - Evgeny_CD(01.10.2013 13:21)
- ADSP-CM40x internal SPI flash reads can occur at throughputs as high as 50 MBytes/second. 100 MHz * 4 / 8 = 50 MBytes/sec. Точнее - 34.50, т.к. есть аномалия :), которая накладывает 70% ограничение на теор. производительность. Внешняя QSPI память PIC32(32 знак., 01.10.2013 12:09)
- Да, SIP. Насчет 100Мгц - она для всех команд, кроме чтения, как я понял. Для чтения 52 Мгц. За документ спасибо! - Evgeny_CD(01.10.2013 11:28)
- В некоторых документах явно сказано, что это SiP. До 2М Quad SPI Flash (скорость 100MHz) внутри ADSP-CM40x корпуса. PIC32(189 знак., 01.10.2013 00:46)