caxapa.ru :: Я сама себе режиссер, а потому исхожу не из требований, а из возможностей. Скажем, если возможности неожиданно окажутся лучше моих ожиданий, то я не стану их кастрировать до уровня ожиданий. А если возможности моих ожиданий не оправдают, то я

Ксения (14.01.2020 12:07, просмотров: 211) ответил my504 на Ксения, может Вы озвучите требования к спектру 150 кГц, а не число отсчетов на период, тем более, что у Вас в DDS при 75 МГц накачки отсчетов только 500.

Я сама себе режиссер, а потому исхожу не из требований, а из возможностей. Скажем, если возможности неожиданно окажутся лучше моих ожиданий, то я не стану их кастрировать до уровня ожиданий. А если возможности моих ожиданий не оправдают, то я готова смириться с тем, что может быть достижимо. Типа "за неимением гербовой пишут на простой". На этом форуме/конференции я выясняю именно технические возможности, а не прошу выполнять мои техзадания.

Ответить

- Ксения, я Вам уже озвучил параметры DAC из даташита на Н7. Время установления около 2 мкс. Аналогдевайсовые ДДС отличаются тем, что в них есть аппаратный NCO способный суммировать код частоты с аккумулятором фазы на частоте накачки и в них есть my504(459 знак., 14.01.2020 12:23)
  - Я ваш ответ уже прочла, но меня сейчас интересуют не аналоговая часть, а цифровая: какова максимальная частота сэмпливания у этого ЦАПа? Т.е. через какое минимальное время ЦАП выставит для DMA признак, что готов принять следующее число в Ксения(268 знак., 14.01.2020 12:39)
    - Это ЕСТЕСТВЕННО нигде не указано, поскольку регистр (как регистр) никакого отношения к самому ЦАПу не имеет. Просто его выходы подключены к самому ЦАПу. И все. Но дело даже не в шине на которой сидит DAC. Для того, чтобы синтезировать КОНКРЕТНУЮ my504(437 знак., 14.01.2020 13:09)
      - Ну, а у самого ЦАПа есть хоть какой-нибудь признак, что предыдущее число он переварил? Или же у него такого признака нет, и допустимо гнать в него цифирь с любой скоростью, вплоть до той, с которой МК способен изменять содержимое своего регистра? Ксения(266 знак., 14.01.2020 13:24)
        
        25 раздел референсного мануала на семейство - 1036 страница и далее. my504(295 знак., 14.01.2020 14:14)
        
        Я поняла так, что ЦАП выдает сигнал dac_ch1_dma наружу, но не могу найти время, через которое он появляется после прихода dac_ch1_trg. Это и есть мой вопрос о скорости "переваривания". - Ксения(14.01.2020 14:38)
        
        Смотрите фиг.205. Данные выскочат из регистра в ЦАП за один клок частоты накачки ЦАПа. То есть задержка составит этот один клок. Если частоты транзакций и накачки ЦАПа некратны, то будет интерференция (джиттер) вплоть до пропуска и my504(159 знак., 14.01.2020 16:16 - 16:22)
        
        Большушее спасибо! Это как раз то, что я хотела знать, но боялась спросить. :) - Ксения(14.01.2020 16:42)
        
        АЦП, в отличии от ЦАПа, требует времени для захвата сигнала и преобразования (если это SAR, конечно). Поэтому в ADC семплируют сам ADC, а источником реквестов транзакций служит бит готовности данных (завершения преобразования). В DAC, как и его my504(438 знак., 14.01.2020 13:52 - 14:05)
    - Это нигде не указано. Регистры ЦАП сидят на шине APB1 (120 MHz max), рассчитывать на частоту обновления хотя бы 10 МГц вполне обоснованно. Но обновлять так часто бессмысленно, и, вероятно, вредно, так как импульсы на выходе ЦАП при обновлении SciFi(31 знак., 14.01.2020 12:57)

Схемы, платы, компоненты